电路中。单就运放目标核算而言，无论是S/H仍是MDAC，都可当作同一类问题处理——即运放闭环体系的功能问题。运放有限增益导致即便时刻满足长，输出任旧存在一个直流差错；运放的有限带宽导致在限制的时刻窗口期内，输出并不可以完成100%精度的树立。要使差错在体系答应范围内，运放的增益和带宽必需要到达必定限值以上。

  在核算之前，咱们有必要先了解一下ADC的架构，这对了解核算进程是有协助的。咱们看上图，它由S/H电路、1~M个流水级和一个FlashADC组成。图中G表明每个流水极扩大相时的闭环增益。关于1.5bit结构，G=2。

  假定运放的增益为A，且暂不考虑寄生电容Cp的影响， MDAC闭环时的反应系数为β，因为运放带来的有限开环增益差错， 可以证明输出电压表达式为：

  其间， 是Vout，ideal是抱负的输出电压如下（详细参阅：怎样推导一个1.5位MDAC的输出函数？）：

  接下来咱们将这个差错量折算到ADC的最前端，折算的办法是将该差错除曾经向增益。依据前文的ADC架构图，设当时级为第i个流水级（i=1~M），折算到输入端的差错为：

  从MDAC传输曲线可看出，其最大输出摆幅是（3/4）*VFS（详细参阅：怎样推导一个1.5位MDAC的输出函数？）。核算时咱们按VFS进行，则上述最大增益差错应该小于全体精度的1/2。则有：

  β值受Cp的影响，实践会小于1/2。因而考虑Cp影响后，因而实践要比表中的核算值更大。可以证明，只需要用替代上述公式中的β就可以取得考虑寄生后的表达式。

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